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Título: Desenvolvimento e caracterização de um MPSOC-NOC baseado em processadores RISC-V
Autor(es): Lima, Arthur Mendes
Orientador(es): Silva, Jones Yudi Mori Alves da
Assunto: Redes de computação
Redes de comunicação
Hardware
Processador digital
Data de apresentação: 6-Out-2022
Data de publicação: 29-Ago-2023
Referência: LIMA, Arthur Mendes. Desenvolvimento e caracterização de um MPSOC-NOC baseado em processadores RISC-V. 2022. 60 f., il. Trabalho de Conclusão de Curso (Bacharelado em Engenharia Elétrica) — Universidade de Brasília, Brasília, 2022.
Resumo: Multi-processor System on Chip (MPSoCs) são sistemas de hardware compostos por múltiplos processadores interconectados. Network-on-Chip (NoCs) representam uma das mais recentes arquiteturas de comunicação intra-chip desenvolvida na indústria moderna. Este projeto propõe a continuação de uma série de trabalhos já realizados que desenvolveram uma arquitetura específica para Image Processing / Computer Vision (IP/CV) denominada de MCVision. Este trabalho utiliza da mesma arquitetura MCVision, com a mesma rede de comunicação intra-chip, adaptada para utilizar processadores RISC-V como elementos de processamento. Assim, foi feito o desenvolvimento da MCVision-RISCV utilizando FPGAs da Xilinx como base de prototipação. Os roteadores desenvolvidos foram integrados a processadores RISC-V disponíveis livremente (open-hardware). O resultado foi a implementação de uma rede 3x3 que realizou aplicações como Sobel e Rotação, foram utilizados 27K look-up-table e 35K flip-flops.
Abstract: Multi-processor System on Chip (MPSoCs) are hardware based systems composed of multiple tiles connected through a network known as Network-on-Chip (NoC). NoCs represent one of the state of the art solution for addressing the problems of inter-chip communications design. This project is a continuation of previous works developed in which was proposed an architecture specifically designed for Image Processing / Computer Vision (IP/CV) applications, The MCVision. Now, further exploration of MCVision architecture by integrating RISC-V processors (MCVision-RISCV), using Xilinx FPGAs and 3x3 mesh setup, the MCVision-RISCV was implemented and deployed Rotation and Sobel applications developed in C/C++. The utilization report yields 7K look-up-table e 35K flip-flops consumed.
Informações adicionais: Trabalho de Conclusão de Curso (graduação) — Universidade de Brasília, Faculdade de Tecnologia, Departamento de Engenharia Elétrica, 2022.
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