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Título: HDJL : uma API Java para descrição genérica de hardware e geração automática de VHDL
Autor(es): Fialho, Alfredo Luiz Foltran
Cunha, Carlos Eduardo da Cruz
Orientador(es): Brandão, Márcio da Costa Pereira
Jacobi, Ricardo
Assunto: Linguagem de programação (Computadores)
Circuito digital
Sistema digital
Hardware
Data de apresentação: 2005
Data de publicação: 29-Jan-2009
Referência: FIALHO, Alfredo Luiz Foltran; CUNHA, Carlos Eduardo da Cruz. HDJL: uma API Java para descrição genérica de hardware e geração automática de VHDL. 2005. 67 f. Monografia (Bacharelado em Ciência da Computação)-Universidade de Brasília, Brasília, 2005.
Resumo: A possibilidade de se simular um circuito digital antes de implementá-lo em hardware é de grande utilidade, pois a simulação não só possibilita a coleta dos resultados muito mais rápida, mas também diminui os gastos com a prototipação. Porém, com o aumento da complexidade dos circuitos digitais projetados atualmente, a utilização das ferramentas existentes tornou-se mais complicada. Uma forma de diminuir essa dificuldade, aumentando, assim, a produtividade, é elevar as ferramentas para um nível de abstração maior. As ferramentas que surpotam o uso de HDLs no nível de transações ainda são raras, assim, uma API Java desempenhando o papel de uma HDL e capaz de gerar código VHDL no nível RT é proposta como solução.
Abstract: The possibility of simulating a digital circuit before implementing it in the hardware has great utility, therefore the simulation not only makes possible the results collection much more fast, but also it diminishes the expenses with the hardware test. However, with the increase of the complexity of the currently projected digital circuits, the use of the existing tools became more complicated. One possibility to diminish this di culty, increasing, thus, the productivity, is to raise the tools for a higher abstraction level. The tools that are compatible with HDLs code in the level of transactions are still rare, thus, a Java API playing the role of a HDL and capable to generate VHDL code in RT level it is proposal as solution.
Informações adicionais: Monografia (graduação)—Universidade de Brasília, Instituto de Ciências Exatas, Departamento de Ciência da Computação, 2008.
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